目录

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    • ● 逻辑代数的基本定律
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      • ● 最小项表达式和最大项表达式的关系
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    • ● 卡诺图法化简逻辑函数
      • ● 逻辑函数的卡诺图表示
      • ● 卡诺图化简的步骤及举例
  • 组合逻辑电路
    • ● 组合逻辑电路的特点
    • ● 组合逻辑电路的分析
      • ● 组合逻辑电路的分析步骤
      • ● 组合逻辑电路分析举例
    • ● 组合逻辑电路的设计
      • ● 组合逻辑电路的设计步骤
      • ● 组合逻辑电路的实现方式
      • ● 组合逻辑电路设计举例
    • ● 中规模组合逻辑电路
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      • ● 编码器
      • ● 译码器
      • ● 数据选择器
      • ● 数值比较器
    • ● 中规模组合电路用于逻辑设计
      • ● 译码电路用作函数发生器
      • ● 用数据选择器作函数发生器
      • ● 用全加器作为数码转化器
    • ● 组合逻辑电路的竞争与冒险
      • ● 冒险的分类
      • ● 冒险的识别和消除
  • 集成触发器
    • ● 时序逻辑电路的特点
    • ● 触发器的基本特性
    • ● 触发器的记忆作用
    • ● 电位型触发器
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      • ● 其他可控触发器
      • ● 可控电位型触发器的局限性
      • ● 电位型触发器的应用:锁存器
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      • ● 主从触发器
      • ● 边沿触发器
    • ● 触发器的逻辑符号
    • ● CMOS触发器
      • ● 带使能端D触发器
      • ● CMOS主从D触发器
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    • ● 触发器的转换
    • ● 集成触发器的时间参数
    • ● 钟控触发器构成的常用时序电路
      • ● 寄存器
      • ● 移位寄存器
      • ● 计数器
  • 时序逻辑电路
    • ● 时序电路的分类和描述
      • ● 时序电路的分类
      • ● 时序电路的描述
    • ● 同步时序电路的分析
      • ● 同步时序电路的一般框图
      • ● 序列信号发生器
    • ● 移位寄存器构成的时序电路
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      • ● 计数器的设计
      • ● 序列信号发生器的设计
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    • ● 计数器用于逻辑设计
    • ● 一般时序电路的分析
      • ● 一般时序电路的分析过程和特点举例
    • ● 一般时序电路的设计
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      • ● 状态表的简化
      • ● 状态分配
  • 大规模数字集成电路
    • ● 大规模数字集成电路的概述
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      • ● 存储器的分类
      • ● ROM作为逻辑器件
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    • ● 可编程逻辑阵列
    • ● 可编程阵列逻辑
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    • ● 复杂可编程逻辑器件
    • ● 现场可编程门阵列
    • ● CPLD和FPGA的比较
逻辑代数的基本定律


定律

互补律:

第一互补律:若A=0,则~A=1,若A=1,则~A=0 注:~A =NOT A

第二互补律:A*~A=0

第三互补律:A+~A=1

双重互补律:/<~A>=//A=A

交换律:

AND交换律:A*B=B*A

OR交换律: A+B=B+A

结合律:

AND结合律:A<B*C>=C*<A*B>

OR结合律: A+<B+C>=C+<A+B>

分配律:

第一分配律: A*<B+C>=<A*B>+<A*C>

第二分配律: A+<B*C>=<A+B>*<A+C>

重言律:

第一重言律: A*A=A 若A=1,则A*A=1;若A=0,则A*A=0。因此表达式简化为A

第二重言律: A+A=A 若A=1,则1+1=1;若A=0,则0+0=0。因此表达式简化为A

带常数的重言律:

A+1=1

A*1=A

A*0=0

A+0=A

吸收率:

第一吸收率: A*<A+B>=A

第二吸收率: A+<A*B>=A